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随着risc-v芯片架构出现后，芯片相关的研发工具也越来越完善，例如编译工具链，仿真工具等，

不过，现实比较遗憾的是，在21世纪，国内由于risc-v芯片生态链的问题，在芯片商业化上，完全比不了ar芯片架构，芯片设计公司很少以risc-v芯片架构去设计研发芯片，

这样的话，就造成了risc-v芯片只是在实验室上…，在商用上还有很远的路要走，

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现在李飞重生到1996年，可以弥补这种遗憾，

要知道，现在的ar还处于迷茫期，大约一年后的时间，ar才好转，开始盈利，

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重生到1996年后，李飞有的是时间和资金，只要积累原始的资金足够后，马上招聘研发人员，进行risc芯片架构研发，

像ar一样，在risc芯片架构的基础上进行研发时，既保留risc芯片架构简单直接的优点，也要拥有自己独特的芯片架构内核，

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想到这里，李飞稍微舒松一口气，因为现在重生了，还有机会去完成在重生前的遗憾，没有坚持对risc芯片架构研发。

不过，研发risc芯片架构，最关键的是需要大量的芯片商用，在不同电子电器设备上，广泛地应用，所以，也只能一步一步踏踏实实地区完成，

于是，李飞拿起办公桌子上的茶杯，喝了一口茶，整个人都轻松许多，把茶杯轻轻地放在办公桌上后，再打开ib笔记本，

打开ib笔记本后，再点击eda芯片设计软件cadence，那么，正式的开始在f芯片，添加显示和时钟模块电路，

由于cadence的元器件库是自带晶体电路的，而里面自带的晶体电路是非常标准的，可以说是与芯片制造工厂同步的，所以，只需要直接添加到f芯片内部电路上就可以，

接下来，就是要做就是软件仿真，如同上次f芯片设计时，对新添加的显示和时钟晶体电路进行仿真，验证设计是否有缺陷…

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一系列仿真验证确定重新设计芯片合格后，就基本可以直接生产了，

（注：risc-v芯片架构并不是cpu处理器设计方案，risc-v只是一个指令集架构，定义了一个指令的标准，可以按照这个指令标准去做cpu处理器。）

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这款f芯片只是添加显示和时钟电路，本来就可以直接量产，但李飞作为一个芯片研发工程师，还是选择一步一步地来，对芯片流片一次，

不过，这次新f芯片流片的费用不高，与上次f芯片流片相比，因为芯片电路没有作更改，只是添加了新功能!

需要注意的是，这次f芯片有添加新功能，需要升级版本号，从v10升级到v20+，并在芯片的datasheet做好工程记录说明，以便区别，